PLATFORM · L1 UNIFIED BASE
Agent 原生 EDA 的
Agent 原生 EDA 的
统一底座
iDB 统一设计数据库 + Platform 执行平面 + Interface 多协议网关 + Evaluation 质量门禁 + Performance 可观测性——让 Agent 的每次调用都有确定性的状态、产物与反馈。
# Agent loads design, takes snapshot, calls tools $ agent.load("aes_core", tech="sky130") → DesignState { cells: 125430, nets: 98420, ... } $ agent.call("iDB.snapshot") → SnapshotRef { id: "snap_7f3a", time: "2026-07-29T..." }
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MODULES
五大模块
从数据到执行、从接入到质量、从观察到反馈——每一层都让 Agent 有确定性的边界。
CORE · CURRENT · C++20
iDB · 统一设计数据库
设计状态的唯一真值。支持 snapshot、typed delta、DirtySet、compare-and-swap commit。所有工具共享同一份内存数据,Agent 可以通过 DesignStatePort 安全读写。
iDB 详情 CORE · D0/DRAFTPlatform · 执行平面
DAG 工作流编译、worker 调度、资源管理、artifact 追踪、进程恢复。将 Agent 的 WorkflowSpec 编译为可执行的 ResolvedWorkflow。
了解 Platform GATEWAY · D0/DRAFTInterface · 多协议网关
统一的 MCP / Python / Tcl 三协议入口。类型化的 request/result,安全隔离,租约栅栏。Agent 不需要知道底层是哪种协议。
Interface 详情 GATE · P0Evaluation · 质量门禁
指标定义、Pareto 比较、gate 判定、regret 计算。Agent 每次修改都需要通过门禁才能 commit——不通过则必须回滚。
Evaluation 详情 OBSERVABILITY · P0Performance · 可观测性
Agent 调用延迟、增量计算成本、闭环性能 trace。让平台团队知道瓶颈在哪,让 Agent 开发者知道工具调用的性价比。
Performance 详情DATA FLOW
一份数据,全局共享
一份数据,全局共享
解析器将 Verilog/DEF/LEF/SDC/SPEF/Liberty 统一加载到 iDB,所有点工具直接读写内存数据——没有文件交接,没有格式损耗。Agent 通过 Interface 安全访问同一份 DesignState。
DATA FLOW
Verilog / DEF / LEF / SDC / SPEF / Liberty
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│ iDB │ ← 统一设计数据库(唯一真值)
│ DesignState │
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│iPL │ │iRT │ │iSTA│ … 点工具(直接读写内存)
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│ Interface │ ← Agent 安全读写(MCP / Python / Tcl)
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LLM Agent